【晶光華課堂】晶振輸出信號類型有哪些？

【晶光華課堂】晶振輸出信號類型有哪些？  晶振輸出信號類型可以提供不同的優(yōu)點和缺點，這取決于你用在什么產(chǎn)品上，重要的是要知道信號類型，避免時鐘信號的衰減和失真。那么晶光華小編今天為大家介紹一下關(guān)于晶振輸出信號都有哪些：

單端輸出：

※Sinewave（正弦波）：這是晶振的自然默認(rèn)信號輸出。它僅由一個基本的正弦頻率輸出組成（不存在任何諧波），正弦波輸出非常適合要求苛刻的低相位噪聲應(yīng)用。

※Clipped Sinewave（削峰正弦波）：通過限制信號輸出，防止波形達(dá)到正常的高點或低點，這樣做可以在不犧牲任何相位噪聲的情況下創(chuàng)建一個方波輸出。這通常是TCXO的輸出波形。

※CMOS【Complementary Metal Oxide Semiconductor】（互補金屬氧化物半導(dǎo)體電路）

※HCMOS【High Speed CMOS】（高速互補金屬氧化物半導(dǎo)體電路）

※LVCMOS【Low Voltage CMOS】（低壓互補金屬氧化物半導(dǎo)體電路）

CMOS和HCMOS以及 LVCMOS 都屬于互補金屬氧化物半導(dǎo)體類別。它們是方波數(shù)字輸出，最適合低頻時鐘，通常低于250 MHz。這將允許時鐘輸出和芯片輸入之間的直接連接。在大多數(shù)情況下，可以使用低阻值串聯(lián)電阻來有效減少信號反射并保持可靠的信號完整性。

※TTL【Transistor to Transistor Logic】（晶體管-晶體管邏輯電路）：這是一種較舊的輸出方式，大部分已被CMOS所取代，這是因為CMOS提供了比TTL更低的成本和更好的抗噪聲性能。CMOS和TTL 都非常適合低功耗、更高的輸出幅度，并且成本相對較低。

差分輸出：

※ECL【Emitter Coupled Logic】（發(fā)射極耦合邏輯電路）：ECL主要是作為TTL的替代品引入的，ECL電路可以非常迅速地改變狀態(tài)，更有能力滿足非常高速的數(shù)據(jù)傳輸需求；缺點則是ECL需要相當(dāng)高的電流才能運行，ECL在使用過程中也使用負(fù)電源，當(dāng)嘗試連接到正基電源設(shè)備時，這可能會帶來挑戰(zhàn)。

※PECL【Positive Emitter Coupled Logic】（正發(fā)射極耦合邏輯電路）：PECL輸出常用于高速時鐘分配電路。這是因為PECL提供了高抗噪性、在長線路長度上驅(qū)動高數(shù)據(jù)速率的能力，以及由于大電壓幅度帶來的良好抖動性能，所以PECL需要高功耗才能運行。 

※LVPECL【Low Voltage PECL】（低電壓正發(fā)射極耦合邏輯電路）：LVPECL 為千兆以太網(wǎng)和光纖通道的使用提供了良好的基礎(chǔ)。LVPECL在電氣上類似于LVDS，但提供更大的差分電壓幅度和略低的功率效率，此外不同品牌可能出現(xiàn)不同的輸入公差。

※CML【Current-Mode Logic】（電流模式邏輯電路）：CML與LVPECL具有相似的性能，主要區(qū)別是CML不需要外部偏差，因此CML在低功耗情況下成為LVPECL的較好替代品。

※LVDS【Low Voltage Differential Signaling】（低電壓差分信號）：LVDS 與 LVPECL 輸出類似，但LVDS功耗更低，電壓波動也更小。LVDS 通常用于滿足高速數(shù)據(jù)傳輸需求，例如時鐘分配或背板收發(fā)器。對于更高的數(shù)據(jù)速率，通常需要HCSL、CML或 LVPECL，但比LVDS 需要更大的功耗。其他優(yōu)點包括降低對噪聲的敏感性，并且易于在CMOS IC中實現(xiàn)。 與PECL相比，LVDS的一個缺點是其抖動性能降低，但正在研究的新技術(shù)將實現(xiàn)與LVPECL相同水平的抖動性能。 

※HCSL【High Speed Current Steering Logic】（高速電流轉(zhuǎn)向邏輯電路）：HCSL有一個更新的輸出標(biāo)準(zhǔn)，類似LVPECL。HCSL的優(yōu)點之一是其高阻抗輸出和快速轉(zhuǎn)換時間。建議使用10至30歐的串聯(lián)電阻以減少可能的過沖和振鈴。其他優(yōu)勢包括最快的切換速度、低功耗（介于LVDS和LVPECL之間）以及平均良好的相位噪聲性能。

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